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ADP3611
Table 4. PIN FUNCTION DESCRIPTIONS
Pin No.
Pin No.
QFN
1
2
3
4
5
Tab
6
7
8
MSOP
1
2
3
4
5
6
7
8
9
10
Symbol
IN
SD
DRVLSD
CROWBAR
VCC
DRVL
GND
SW
DRVH
BST
Description
Logic Level PWM Input. This pin has primary control of the drive outputs. In normal operation, pulling
this pin low turns on the low ? side driver; pulling it high turns on the high ? side driver.
Shutdown Input. When low, this pin disables normal operation, forcing DRVH and DRVL low.
Synchronous Rectifier Shutdown Input. When low, DRVL is forced low; when high, DRVL is enabled
and controlled by IN and by the adaptive overlap protection control circuitry.
Crowbar Input. When high, DRVL is forced high regardless of the high ? side MOSFET switch condition.
Input Supply. This pin should be bypassed to GND with a 4.7 m F or larger ceramic capacitor.
Synchronous Rectifier Drive. Output drive for the lower (synchronous rectifier) MOSFET.
Ground. This pin should be closely connected to the source of the lower MOSFET.
Switch Node Input. This pin is connected to the buck ? switching node, close to the upper MOSFET’s
source. It is the floating return for the upper MOSFET drive signal. It is also used to monitor the
switched voltage to prevent turn ? on of the lower MOSFET until the voltage is below ~1 V.
Buck Drive. Output drive for the upper (buck) MOSFET.
Upper MOSFET Floating Bootstrap Supply. A capacitor connected between the BST and SW pins
holds this bootstrapped voltage for the high ? side MOSFET as it is switched.
http://onsemi.com
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